La publicación analiza la función de asignación de pines y otras especificaciones importantes del IC 4043. Conozcamos la hoja de datos completa de este chip muy interesante.
Pinout Hoja de datos de IC 4043
Técnicamente, el IC 4043 es un pestillo cuádruple de ajuste / reinicio (R / S) con 3 salidas de estado lógico.
Para ser más precisos, este chip tiene 4 conjuntos de entradas (es decir, 8 pines de entrada) y 4 salidas individuales correspondientes.
Los 4 conjuntos de entradas constan de 4 pares de entradas de activación / desactivación.
Para cada set / reset tenemos una salida correspondiente.
Todas estas entradas de reinicio configuradas responden a señales lógicas altas, creando un efecto biestable en sus correspondientes pines de salida.
Flip / Flop biestable
Biestable se refiere a la acción del flip flop, en otras palabras, un pulso alto a la entrada 'configurada' hace que la salida correspondiente sea alta desde su estado bajo original, y un alto a la entrada de reinicio revierte el estado anterior de alto a estado bajo.
Por lo tanto, básicamente para hacer que las salidas correspondientes sean altas, necesitamos aplicar un valor alto en sus entradas 'configuradas' y para hacer que las salidas sean bajas nuevamente, simplemente debemos aplicar otro alto a sus entradas de reinicio.
El funcionamiento de los pines de entrada y salida es tan simple como eso.
Además de esto, el IC tiene otro pinout de entrada interesante OE que es un pinout de habilitación de salida común.
Función Set / Reset
Para habilitar las acciones de ajuste / reinicio explicadas anteriormente en el IC, esta entrada OE debe conectarse con lógica alta o simplemente con Vdd (potencia de suministro).
En la situación anterior, la salida se permite con el funcionamiento del flip flop especificado.
Si la entrada OE está conectada a tierra, la salida se congela y produce una respuesta de alta impedancia, que no muestra una salida baja ni alta, sino que bloquea la entrada en un estado bloqueado que no responde, de ahí el nombre de salida de estado lógico 3.
Por lo tanto, la entrada OE puede usarse para apagar el funcionamiento del IC si es necesario para una aplicación en particular.
El IC funciona mejor con voltajes de suministro de 5 a 15 V.
Resumamos las funciones y especificaciones de los pines de entrada y salida del IC 4043 con los siguientes datos:
- 1Q a 4Q (Pines: 2, 9, 10, 1) Salida de pestillo con búfer de 3 estados
- 1R a 4R (Pines: 3, 7, 11, 15) entrada de reinicio (activo ALTO)
- 1S a 4S (Pines: 4, 6, 12, 14) establecer entrada (activo ALTO)
- Entrada de habilitación de salida común OE (Pin: 5)
- VSS (Pin: 8) tensión de alimentación a tierra
- N.C. (Pin: 13) no conectado
- Voltaje de suministro VDD (Pin: 16)
Más actualizaciones:
En estas publicaciones tratamos de comprender el funcionamiento del IC 4043 y el IC 4044 mediante el estudio de las diversas especificaciones, la hoja de datos de los dispositivos y su disposición de pines.
Básicamente, ambas variantes son R / S de 3 estados CMOS de acoplamiento cruzado cuádruple o pestillos de reinicio / ajuste. Quad significa que tiene 4 salidas que se pueden configurar o enclavar con un nivel lógico alto a través de una señal de entrada de control, o restablecer a cero lógico mediante una señal de entrada posterior.
La función de 3 estados permite controlar los circuitos integrados mediante 3 lógica
El principio de funcionamiento básico de IC 4043 e IC 4044 es el mismo que el anterior, la única diferencia es que IC 4043B son cuádruples de 3 estados de acoplamiento cruzado NI Latch e IC 4044B son cuádruples acoplados en cruz de 3 estados NAND Pestillo.
Diagrama de pines
Los siguientes diagramas de pines de los circuitos integrados muestran la estructura interna y los detalles de los pines de los dispositivos:
En los diagramas de arriba podemos ver que cada uno de los tipos tiene 4 pestillos con una salida y 2 entradas individuales RESET / SET. La función del pin ENABLE para todas las entradas SET / RESET es idéntica.
Una lógica ALTA en el pin ENABLE permite que los estados del pestillo se conecten con las salidas relevantes, un nivel lógico bajo o 0 desconecta los estados del pestillo de sus salidas provocando un circuito abierto completo en las salidas.
NOR Latch, Diagramas lógicos equivalentes de NAND Latch
Los siguientes diagramas muestran los pestillos equivalentes en forma de pestillos NOR y NAND, que están presentes dentro de cada uno de los 4 pestillos de los circuitos integrados individuales.
Como podemos ver, cada uno de los bloques de enclavamiento se controla mediante 3 entradas de control lógicas, a saber, SET, RESET y ENABLE, por lo que la salida depende de estos 3 estados de entrada. La tabla de verdad para estos 3 estados lógicos se puede aprender del siguiente diagrama:
En la tabla de verdad anterior, la forma completa de los diversos alfabetos simbólicos abreviados se puede entender como se indica a continuación: S = SET Pin R = RESET Pin E = HABILITAR Pin Q = SALIDA Pin OC = Circuito abierto NC = Sin cambio
Las características principales de IC 4043 e IC 4044 se resumen a continuación:
Práctica simulación básica de funcionamiento de los pines SET / RESET y ENABLE
Descripción de trabajo
A partir del GIF de simulación anterior podemos entender el funcionamiento de los módulos de pestillo cuádruple con los siguientes puntos:
Cuando el pin SET se aplica con un suministro positivo, la salida se eleva y se bloquea incluso si el potencial positivo se elimina del pin SET, como lo indica el LED rojo (polarización directa).
Cuando el pin RESET se aplica con un pulso positivo, el pestillo se rompe y la salida pasa a BAJA permanentemente incluso si se quita el positivo del pin RESET. Esto se indica mediante la iluminación del LED azul.
Las operaciones anteriores se pueden implementar solo mientras el pin ENABLE del IC tenga un potencial de suministro positivo. Cuando se conecta a un potencial negativo o de tierra, la salida del pestillo se abre y no responde a las operaciones SET / RESET.
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